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Extracción de capacitancias parásitas de transistores FinFETs de tres compuertas

Extracción de capacitancias parásitas de transistores FinFETs de tres compuertas

Detalles Bibliográficos
Autor principal: Lucario Matías, David
Otras Contribuciones: Tinoco Magaña, Julio César (Asesor)
Formato: Tesis de licenciatura
Publicado: México 2011
Materias:
Ciencias Físico - Matemáticas y de las Ingenierías
Acceso en línea:https://hdl.handle.net/20.500.14330/TES01000677602
https://tesiunamdocumentos.dgb.unam.mx/ptd2012/febrero/0677602/Index.html
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https://hdl.handle.net/20.500.14330/TES01000677602
https://tesiunamdocumentos.dgb.unam.mx/ptd2012/febrero/0677602/Index.html

Ejemplares similares

  • Validación experimental del modelo de circuito equivalente de pequeña señal para transistores FinFET de tres compuertas
    por: Hernández Román, Mario Alberto
    Publicado: (2014)
  • Extracción del modelo de circuito equivalente de pequeña-señal de transistores FinFET
    por: Antonio Flores, Lorenzo
    Publicado: (2011)
  • Optimización de los efectos parásitos en transistores finfet de tres compuertas para aplicaciones analógicas de muy alta frecuencia
    por: Antonio Flores, Lorenzo
    Publicado: (2013)
  • Multiplicadores de frecuencia basados en transistores tipo fet
    por: Wingartz Plata, Adela
    Publicado: (2005)
  • Desarrollo de una metodología de fabricación de transistores de compuerta flotante por fotolitografía
    por: Popoca Sánchez, Galia
    Publicado: (2025)

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